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发布日期：2026-10-28 07:01    点击次数：181

IT之家 2 月 11 日音尘，英特尔下一代 Nova Lake 处置器更多细节渐渐流出。

凭据爆料者 HXL 本日最新深刻的信息，Nova Lake 选择台积电 N2 工艺，计较芯片（Compute Tile）选择 8 个 P 核 +16 个 E 核的基础成就，其裸晶圆面积（Die Size）远超 AMD 竞品。

算作参考，AMD 现存 Zen 5 处置器的 CCD 为 8 核，晶圆面积约 71mm²；而 Zen 6 展望将把每个 CCD 进步至最多 12 核，面积揣测约 76mm²。

按此对比，Nova Lake 轨范芯单方面积比 Zen 5 CCD 大了约 55%，比拟 Zen 6 CCD 大了约 44%。

Nova Lake 桌面处置器与出动处置器均选择 8P+16E 基础成就，但也和会过屏蔽部分中枢提供面向初学与主流市集的 4P+8E 型号。

天然英特尔也曾推出了基于 Intel 18A 制程的 Panther Lake 处置器，但由于性能库的原因无法提供桌面处置器版块，而下一代 Nova Lake 的计较芯片将结伴选择台积电 N2 工艺。

在中枢与结构方面，现存爆料涌现 Nova Lake 将搭载基于 Coyote Cove 架构的 P 核，以及基于 Arctic Wolf 架构的 E 核。P 核部分的布局则是每簇 2 个中枢，并为每个簇成就 4MB 的 L2 缓存。

访佛于 Panther Lake，英特尔还会在孤苦区域内置 4 个 LPE 低功耗中枢（这部分中枢无法超频），但可用于低功耗驱动场景，致使不错在 P 核与 E 核被禁用的情况下单独职责。

另外，爆料涌现英特尔 Nova Lake 还将推出双计较芯片的 52 核旗舰型号。轨范双芯片版块的面积约为 220mm²；而选择 bLLC 大缓存的双芯片版块接近 300mm²，最大可提供 288MB 的 L3 缓存，总缓存界限（L2+L3）可达到 320MB，但 TDP 也将提高到 175W。

尽管计较芯片本人占用面积显赫增多，但爆料称这些 sku 仍会选择并吞封装，况兼会使用雷同的 LGA1954 插槽。

值得一提的是 bLLC 与 AMD X3D 堆叠时候并不交流体育游戏app平台，天然英特尔也有访佛 X3D 的特殊缓存时候，但现在并未在 Nova Lake 上利用。

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